it芯片|【FPGA学习】如何创建使用IP核-PPL?( 二 )

sys_rst_n系统复位M1clk_100m输出100MHz时钟D1clk_10m输出10MHz时钟F34、编译结果
编译后 , 占用了一个PLL的ip核 。


【it芯片|【FPGA学习】如何创建使用IP核-PPL?】可以使用示波器 , 测量D1、F3引脚时钟周期 。