太平洋电脑网@Architect，加速设计收敛周期，新思科技推出RTL 新思科技近日宣布推出创新产品RTLArchi

新思科技近日宣布推出创新产品RTLArchitect? ，该产品可将设计周期在RTL中向左推移（shiftleft）有助于加快设计收敛周期。 RTLArchitect是业界首个物理感知RTL设计系统，可将芯片设计周期减半，并提供卓越的结果质量（QoR）。

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RTL团队日益面临快速探索特定领域RTL架构来提高功耗、性能和面积(PPA)的挑战，以满足人工智能和汽车应用等新的垂直市场的要求。现有的用于估计RTL质量的点工具解决方案由于下游实施的准确性较差而受到严重限制。早期设计周期的不准确性导致下游实现工具需要相互弥补，通常需要返回并进行RTL更改来实现PPA目标。 RTLArchitect基于FusionDesignPlatform实现环境的快速多目标预测引擎来应对这些挑战，从而准确预测下游实施的PPA 。 RTLArchitect使RTL开发者能够查明源代码中的瓶颈，从而提高RTL质量。
瑞萨电子株式会社EDA共享研发数字设计部门技术总监HideyukiOkabe表示：“瑞萨最先进的汽车片上系统具有一定的复杂性，需要通过架构调整来实现最高的QoR ，从而在目标市场中脱颖而出。 RTLArchitect能够在RTL阶段快速探索和验证各种架构，帮助瑞萨在确定最佳架构的同时不必担心后期突发状况。 ”
Arm中央工程组CPU工程副总裁JeffKehl表示：“与新思科技就RTLArchitect产品展开合作，有助于更进一步加快新一代Arm?处理器芯核的RTL开发周期。先进芯核开发设计方法采用RTLArchitect技术将助力Arm开发更好的CPU ，以满足Arm与新思科技共同客户的新功耗和性能要求。 ”
RTLArchitect系统建立在统一的数据模型上，该模型提供数十亿的门极（gatelevel）容量和全面的层次化设计能力以适应先进工艺技术下不断扩大的设计和系统区块尺寸。 RTLArchitect系统采用新思科技世界级实现和金牌signoff解决方案，在设计周期早期提供准确的结果，并按构造进行关联。
RTLArchitect采用快速多维实现预测引擎，通过该引擎RTL设计人员能够预测RTL更改对功耗、性能、面积以及堵塞带来的影响。该产品直接与新思科技PrimePower金牌signoff功耗分析引擎相接合，可进行准确的RTL功率估算和优化，以实现节能设计。 RTLArchitect提供统一的工作流环境，以简易性方式来无缝分析关键PPA质量指标。现有门级PrimePower用户也可使用PrimePowerRTL功耗预估功能，为signoff功耗分析流程提供一致的RTL 。
【太平洋电脑网@Architect，加速设计收敛周期，新思科技推出RTL】新思科技芯片设计事业部设计高级副总裁ShankarKrishnamoorthy表示：“达到最佳设计PPA,实现快速的RTL调整迭代和快速的架构探索，对新思科技转向更小技术节点至关重要。在设计初期创造出最优质量的RTL ，对于实现最佳QoR和最快的结果时间也尤为关键。 RTLArchitect旨在帮助开发者交付卓越的RTL设计，以缩短设计收敛流程并实现最佳PPA 。 ”